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- 题名/责任者:
- Verilog与SystemVerilog编程陷阱:如何避免101个常犯的编码错误/(美)斯图尔特·萨瑟兰(Stuart Sutherland),(美)当·米尔斯(Don Mills)著 戴成然,高镇译
- 出版发行项:
- 北京:机械工业出版社,2015
- ISBN及定价:
- 978-7-111-50316-3/CNY55.00
- 载体形态项:
- 155页;24cm
- 并列正题名:
- Verilog and SystemVerilog gotchas:101 common codingerrors and how to avoid them
- 其它题名:
- 如何避免101个常犯的编码错误
- 丛编项:
- 电子与嵌入式系统设计译丛
- 个人责任者:
- (美) 萨瑟兰 (Sutherland, Stuart) 著
- 个人责任者:
- (美) 米尔斯 (Mills, Don) 著
- 个人次要责任者:
- 戴成然 译
- 个人次要责任者:
- 高镇 译
- 学科主题:
- 硬件描述语言-程序设计
- 中图法分类号:
- TP312
- 版本附注:
- 由Springer Science+Business Media授权出版
- 提要文摘附注:
- 本书论述了Verilog和SystemVerilog中超过100个常见的编程错误,不仅仅包含错误的细节,还包含如何避免错误的细节。
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索书号 | 条码号 | 年卷期 | 馆藏地 | 书刊状态 | 还书位置 |
TP312/S03-2 | 01173735 | 2015 - | 语言、自然科学阅览室 | 可借 | 语言、自然科学阅览室 |
TP312/S03-2 | 01173734 | 2015 - | 样本书阅览室 | 非可借 | 样本书阅览室 |
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